發明
美國
16/459,399
US 10,630,270 B1
Down-conversion mixer
國立暨南國際大學
2020/04/21
1. 本發明主要應用在射頻電路之前端的應用上,並提出若干新的設計架構用來改善射頻前端電路之降頻混波器的效能,用以增加降頻混波器可延伸出的應用層面。 2. 本發明基於改良型降頻混波器所延伸出來的全新設計提出一 CCPT-RL–Based Core IF Load(Parallel Cross-Coupled PMOS Transistors and the Series RL circuit),使得降頻混波器的負載值能夠進行調整,並且根據調整的結果,可以改善傳統架構的四大缺點 :1. 轉換增益不夠高,2. 雜訊指數不夠低,3. 轉換增益無法調整,4. 線性度不佳。 3. 本發明提出之全新設計可基於本地震盪訊號(LO)的相位差,延伸出使用 Differential IQ 的第三實施例以及第四實施例。 本發明是基於改良型降頻混波器所延伸出來的全新設計。本發明提出一 CCPT-RL–Based Core IF Load(Parallel Cross-Coupled PMOS Transistors and the Series RL circuit),使得降頻混波器的負載值能夠進行調整,並且根據調整的結果,可以改善傳統架構的四大缺點 :1. 轉換增益不夠高,2. 雜訊指數不夠低,3. 轉換增益無法調整,4. 線性度不佳。圖 3 左圖為本發明之可變增益降頻混波器的第一實施例之示意圖(因為RL可變,根據(7) & (9),轉換增益可變)。圖 3 右圖為本發明之可變增益降頻混波器的第二實施例之示意圖(因為gm9,10 可變,根據(9),轉換增益可變)。圖 3 左圖可進一步改成LO及IF端皆為differential IQ(四相位,90, 180, 270, 360 degree)的第三實施例。圖 3 右圖可進一步改成LO及IF端皆為differential IQ的第四實施例。
本會(收文號1120047895)同意該校112年6月9日暨校研字第1121003534號函申請終止維護專利(國立暨南國際大學)/依本會112年第3次研發成果管理審查會決議辦理
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