發明
中華民國
098138542
I 410142
內插式多工器INTERPOLATED MULTIPLEXER
國立高雄第一科技大學
2013/09/21
本發明係有關於一種內插式多工器,該內插式多工器主要係設有兩相對應之多工器,令兩多工器輸入端之各相對應輸入線予以相互併聯,且兩多工器之選擇控制端分別皆連接設有控制暫存器,該控制暫存器之輸入端與一選擇控制線並聯,且將一時序訊號線與其中一控制暫存器之時序輸入端連接,並令該時序訊號線一併與一反向器連接,再由該反向器之輸出端連接至另一控制暫存器之時序輸入端,而兩多工器之輸出端則分別與內插器之輸入端連接,以將兩輸入端輸入訊號平均,再由該內插器之輸出端進行內插式多工器之訊號輸出;藉此,以具有緩衝保護作用,能避免瞬間過大的雜訊對後端電路造成損壞,而在其整體施行使用上更增實用價值性者。 This patent is to design a interpolated multiplexer. The output the interpoloated can interplaoted the input signals Q(n) and Q(n+1).
本部(發文號1080031579)同意貴校108年5月22日高科大研字第1082800318號函申請終止維護專利。
研究發展處
6011000
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